CPUモデルの実行スピード結果例 |
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ホストPC側のマルチコア活用してマルチコアSoCモデルを高速シミュレーション |
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Eclipse対応デバッガ |
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VAP (Verification, Analysis and Profiling)ツール |
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・RISC-V | : RV32/64 IMAFDCEN SiFive, Andes | |
・Arm | : for Armv4, v5, v6, v7 and v8 architectures | |
・MIPS | : microMIPS, MIPS32 and MIPS64 architectures | |
・Renesas | : RH850, V850 architectures; 16-bit microcontroller cores | |
・Synopsys | : ARC6xx, ARC7xx, EM families | |
・Intel | : Nios II | |
・Xillinx | : Microblaze |
● ハードウェア検証適用例
適用例 1.RISC-V RTL*検証用のリファレンスモデルとしての利用※クリックすると拡大画像が表示されます。
RTL検証ソリューションのグレード |
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SiFive社FU540 SOCモデル |
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RISC-V向けシミュレーションモデル |
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RISC-V プラットフォームおよび周辺モデル |
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Imperas社の高速RISC-V命令セットシミュレータのご紹介 本ウェビナーでは、Imperas社のRISC-V高速命令セットシミュレータの特長とRISC-V IP開発者向けのデザインベリフィケーションの用途を解説します。RISC-Vモデルの最新状況やImperas社が運営するOVP(Open Virtual Platform)についても紹介します。ソフトウェア開発者およびIP開発者の両方の方にご視聴いただける内容となっています。 >>お申し込みはこちら |
以下のリンクからブログ記事をご参照いただけます。
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